【摘 要】
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随着A/D转换器的应用越来越广泛,高速A/D转换器的研究越来越受到重视。在众多A/D转换器电路结构中,折叠内插结构具有高速、低功耗、面积小及易与数字工艺兼容等优点。本论文
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随着A/D转换器的应用越来越广泛,高速A/D转换器的研究越来越受到重视。在众多A/D转换器电路结构中,折叠内插结构具有高速、低功耗、面积小及易与数字工艺兼容等优点。本论文对用于无线局域网的8位、200MS/s转换速率的折叠内插A/D转换器进行了设计。所设计的8位折叠内插A/D转换器的总体结构分粗量化和细量化两部分。粗量化器采用Flash结构产生高4位,细量化采用两级折叠内插结构产生低4位。论文详细分析了折叠内插A/D转换器的各个组成模块,并对各个模块进行了电路级设计与优化,包括采样保持电路、预放大器、折叠内插电路、比较器、差分基准产生电路、时钟产生电路、编码电路、数字校正与同步输出电路等。仿真结果表明,各个单元电路均满足了系统性能的要求。采用SMIC 0.18μm 1P6M CMOS工艺,对所设计的高速A/D转换器进行了版图设计,并进行了仿真验证。静态特性仿真结果表明,所设计的A/D转换器没有失码,微分非线性误差(DNL)的最大值为0.51LSB,积分非线性误差(INL)的最大值为0.83LSB。动态特性仿真结果表明,在200MHz采样频率下,A/D转换器的最小的有效位数可以达到6.58位,最大有效位数为7.31位。
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