FPGA位流生成及其压缩

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与专用集成电路芯片ASIC(Application Special Integrated Circuit)不同,现场可编程器件FPGA(Field Programmable Gate Array)在设计完成时并没有确定的逻辑功能,而是由用户根据自己的设计需求对其进行编程,生成相应的配置文件下载到FPGA中,赋予FPGA芯片具体的逻辑功能。本文围绕FDP250K芯片硬件结构研究,针对各种可编程资源进行了细致的研究并进行建模,加以文本描述,生成芯片配置库文件。位流生成模块通过解析工艺映射,布局布线得到的用户网表信息,经过处理,确定芯片内各种可编程资源的具体配置,并从芯片配置库读取对应的编码点信息,生成配置文件。这样,用户的设计网表经过工艺映射,布局布线,位流生成后能生成对应硬件的配置文件,下载到芯片中就能实现特定的功能。随着FPGA规模的扩大和性能的大幅度提高,FPGA的配置文件也相应增大,从而不仅使配置时间迅速增加,而且对存储配置文件的外部存储器(如PROM)容量有很高的要求。针对这两个问题,本文提出了一种基于LZW(Lempel ZivWelch)改进的FPGA配置文件压缩算法能有效的减小配置文件大小,提高芯片配置速度,且相应的硬件解压缩电路也比较简单,能够在很大程度上降低系统的开销,提高了整个系统的性能。这种方法能适用于所有的基于SRAM单元结构的FPGA。实验数据表明,使用本算法压缩后的配置文件大小可以控制到压缩前的20%以内。
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