高速密码专用芯片研究与设计

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该文是参加"十五"863计划项目《密码算法标准研究及其关键芯片集成技术》和国家商用密码分组算法、HASH算法标准研制项目的过程中,对密码专用芯片的设计理论和技术进行了研究,在具体工作的基础上形成的.该文主要探讨密码芯片的设计理论和技术,重点内容是密码芯片的性能优化以及AES芯片、RSA大整数模乘的快速硬件实现.在芯片的性能优化方面,论述了流水线并行设计的要点,电路描述的优化,以及芯片设计的流程.针对对称算法和公钥算法两种类型,分别以AES和RSA为例进行实现分析和优化.在AES芯片设计部分,给出了GF(2<,n>)域上运算的快速硬件实现和分组对称芯片的模块结构;在RSA硬件设计部分,提出大整数模乘器CIOS算法的一种采用并行流水线的快速硬件设计,并对FIOS方法中乘法运算的快速并行进行了分析.
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