【摘 要】
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为了保障HCTR在无线链路中能够可靠的传输数据,就需要进行信道编码.RS码由于其特殊的编码规则,特别适用于突发性错误译码.但其算法比较复杂,因此它的译码大都交由DSP来实现,
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为了保障HCTR在无线链路中能够可靠的传输数据,就需要进行信道编码.RS码由于其特殊的编码规则,特别适用于突发性错误译码.但其算法比较复杂,因此它的译码大都交由DSP来实现,在处理速度上受到一定限制.而可编程逻辑器件(PLD)以硬件速度执行指令,速度可得到保证.并且随着工艺水平的提高,其规模越来越大,使它足以有能力进行复杂算法设计.该论文研究的重点就是利用CPLD实现RS码的编译码器.论文简要介绍了信道编译码的基本概念,详细描述了RS码的编译码算法,并将算法影射为电路结构,使之以硬件形式完成所需功能.最后给出了可综合的RS(63,45)码编译码器的VHDL模型,并将它综合在Altera公司的FPGA芯片中.由仿真结果和在实际环境中运行证明,此编译码器性能优良,运行速度满足系统设计要求.
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