一种用于加速度计中的五阶sigma-delta调制器

来源 :电子技术应用 | 被引量 : 0次 | 上传用户：qjesen

【摘要】

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采用CHRT 0.35 μm CMOS工艺,设计实现了一种用于加速度计中的单环五阶sigma-delta（∑△）调制器.在MATLAB/Simulink下对调制器进行建模,优化参数实现一个稳定的高阶系统,利用根

【作者】

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程磊陈中良

【机构】

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黄淮学院

【出处】

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电子技术应用

【发表日期】

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2015年3期

【关键词】

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低通∑△调制器建模高阶根轨迹 low-pass ∑△ modulator modeling high-order root locus

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采用CHRT 0.35 μm CMOS工艺,设计实现了一种用于加速度计中的单环五阶sigma-delta（∑△）调制器.在MATLAB/Simulink下对调制器进行建模,优化参数实现一个稳定的高阶系统,利用根轨迹法分析了系统的稳定性.该电路在250 kHz采样频率、3.3V电压下功耗为3.4 mW.后仿真结果显示,在1 kHz信号带宽下信噪比为108.6 dB,有效位数约为18位,满足了加速度计对后级高精度调制器的要求.

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