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基于AMBA总线接口，设计了一个可灵活配置为Master／Slave模式、可设置传输速率并能适用于4种时钟模式的SPI协议IP核。详细说明了该IP核的系统构架、接口信号和子模块设计，使用Verilog HDL实现硬件设计，通过FPGA时序仿真，验证了该设计在实际工程应用中的有效性。
基于AMBA总线的SPI协议IP核的设计与验证
【摘 要】
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基于AMBA总线接口，设计了一个可灵活配置为Master／Slave模式、可设置传输速率并能适用于4种时钟模式的SPI协议IP核。详细说明了该IP核的系统构架、接口信号和子模块设计，使用Ver
【机 构】
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中国科学技术大学物理系微电子实验室
【出 处】
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电子测量技术
【发表日期】
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2010年1期
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