MPEG-2MP@HL高清实时解码器的VLSI设计实现

来源 :高技术通讯 | 被引量 : 0次 | 上传用户：maxwang007

【摘要】

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研究了可用于高清数字电视的MPEG-2 MP@HL解码器的设计与ASIC实现.解码器芯片的最高位流速率可达到80Mbps.采用了并行流水线技术架构,可有效地减小处理时延,降低时钟频率;具

【作者】

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杨宇红王峰董威张文军凌阳邱琳

【机构】

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上海交通大学图像通信与信息处理研究所

【出处】

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高技术通讯

【发表日期】

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2005年9期

【关键词】

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MPEG-2 MP@HL 解码器并行流水架构 HDTV 设计实现 VLSI 实时总线仲裁 ASIC 数字电视技术架构 MPEG-2MP@HL decode

【基金项目】

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国家高技术研究发展计划(863计划)

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研究了可用于高清数字电视的MPEG-2 MP@HL解码器的设计与ASIC实现.解码器芯片的最高位流速率可达到80Mbps.采用了并行流水线技术架构,可有效地减小处理时延,降低时钟频率;具有合理的存储器总线仲裁方案,可降低缓存器的大小;采用了并行总线架构,可保证足够的带宽,不需提高存储器的总线传输频率,从而减小电路的功耗.采用0.18um工艺成功进行了流片.

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