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针对晶体振荡器的温漂特性,设计了一种基于分频链的时钟校准算法。在不改变晶体振荡器的情况下可调节时钟频率,校准精度达±0.25ppm,校准范围±32ppm,通过多次实验分析,用Verilog-HDL语言编写全部模块,在modelsim6.2b软件中实现模块仿真。全部功能正常实现,符合设计要求。
一种基于分频链的时钟校准方法
【摘 要】
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针对晶体振荡器的温漂特性,设计了一种基于分频链的时钟校准算法。在不改变晶体振荡器的情况下可调节时钟频率,校准精度达±0.25ppm,校准范围±32ppm,通过多次实验分
【机 构】
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西安邮电学院电子工程学院,西安邮电学院通信与信息工程学院,西安深亚电子有限责任公司
【出 处】
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中国集成电路
【发表日期】
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2011年7期
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