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期刊论文
基于FPGA的高精度计时系统设计
基于FPGA的高精度计时系统设计
来源 :电子制作 | 被引量 : 0次 | 上传用户:ck2112
【摘 要】
:
基于Altera FPGA为核心设计高精度计时仪,方案采用Verilog HDL编程实现高精度连续计时模块,并把相应的数据信息经过处理后通过RS232串口上传至上位机。该方案系统集成度高、
【作 者】
:
齐锦
李杰
张远
刘成
刘灏
【机 构】
:
西北大学信息科学与技术学院,中国兵器工业第203研究所
【出 处】
:
电子制作
【发表日期】
:
2014年21期
【关键词】
:
FPGA
连续计时
RS232
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基于Altera FPGA为核心设计高精度计时仪,方案采用Verilog HDL编程实现高精度连续计时模块,并把相应的数据信息经过处理后通过RS232串口上传至上位机。该方案系统集成度高、工作可靠,达到既定计时精度要求。
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