【摘 要】
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随着LVDS技术在高速数字系统中的应用,由于布局、布线等原因使LVDS数据和时钟出现错位情况。本文提出了自校验技术在接收AD9252LVDS信号时的应用,可以使接收到的数据实现自动
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随着LVDS技术在高速数字系统中的应用,由于布局、布线等原因使LVDS数据和时钟出现错位情况。本文提出了自校验技术在接收AD9252LVDS信号时的应用,可以使接收到的数据实现自动纠错的功能,从而增加了LVDS数据传输的稳定性。此技术通过Verilog HDL实现,已通过FPGA验证。
With the application of LVDS technology in high-speed digital systems, LVDS data and clocks are misplaced due to layout, cabling and other reasons. This paper presents the application of self-checking technology in receiving AD9252 LVDS signals, which can make the received data realize the function of automatic error correction, thus increasing the stability of LVDS data transmission. This technology is implemented with Verilog HDL and has been validated by FPGA.
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