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提出一种新型结构的内存控制单元，此单元在完成访存操作的同时，可并行执行多种为访存优化的微操作，如自增量和自减量操作。且可实现对循环队列的支持，最后，文章给出了一种使用CSA结构的硬件实现。通过这种方法，整个内存控制单元可获得约45％的速度提升，而单元面积仅有10％的增加。
一种针对DSP内存控制优化的硬件结构设计
【摘 要】
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提出一种新型结构的内存控制单元，此单元在完成访存操作的同时，可并行执行多种为访存优化的微操作，如自增量和自减量操作。且可实现对循环队列的支持，最后，文章给出了一种使用CSA
【机 构】
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上海交通大学微电子学院
【出 处】
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仪表技术
【发表日期】
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2008年4期
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