【摘 要】
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介绍了环绕立体声处理ASIC设计中的基于多路选择器结构的并,J乘法器设计原理及实现方法,这种并行乘去器适合四级指令流水线结构的处理器对声音信号的实时处理.其结构规则,有
【机 构】
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华南理工大学应用物理系专用集成电路研究室
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介绍了环绕立体声处理ASIC设计中的基于多路选择器结构的并,J乘法器设计原理及实现方法,这种并行乘去器适合四级指令流水线结构的处理器对声音信号的实时处理.其结构规则,有利于VLSI设计实现并且提高了设计效率.使用VHDL语言描述并进行综合和仿真.结果表明,其占用硬件资源较省, 工作频率可达47.2MHz,满足声音信号实时处理要求.
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