基于FPGA的视频压缩IP核设计

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目前,设计和制造复杂电子系统的主要手段已经由“芯片+PCB板”模式发展成为“IP+SOC”模式。系统级芯片(SOC)的设计大多采用以IP核为主的预定制模块,IP核已经成为未来主流芯片设计的核心构件。 随着人们对多媒体需求的日益增长,视频压缩技术得到了长足的发展。在各种视频压缩标准中,H.263针对低码率通信信道,可以取得非常好的压缩效果。 结合视频压缩的理论以及IP核设计中对于仿真验证的要求,本文设计了视频压缩IP核FPGA仿真验证平台。其硬件子平台以Xilinx公司XC2V3000为核心,针对视频压缩IP核应用仿真要求设计外围电路,构建一个视频压缩IP核的硬件仿真原型,采用运行于上位机上的控制和驱动软件作为软件解码子平台。同时还设计了完全独立于硬件之外的ModelSim软件仿真验证平台。 以FPGA仿真验证平台为载体,本文设计了基于H.263协议的视频压缩IP核。经过ModelSim下的软件平台仿真调试与硬件平台调试相结合的手段,作者完成了视频压缩IP核的仿真验证。
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