基于UVM架构的EHCI验证环境研究与开发

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随着芯片工艺技术的高速发展,芯片功能越来越复杂,前期IP RTL级功能验证在整个芯片制作流程中发挥重要作用。传统的直接测试已经不能满足市场需要,基于SystemVerilog的随机验证法已经成为数字IC验证的主流。由SystemVerilog语言发展出来的验证方法论中,UVM验证架构以其可扩展和可复用性而被多家IC设计公司广泛采用。基于USB2.0(Universal Serial Bus)传输协议的电子产品在日常生产生活中已经得到广泛应用。EHCI(Enhancement Host Control Interface)提出descriptor概念,使USB2.0产品传输效率大大提升。当然EHCI作为高速主机控制器,需要满足EHCI规格,USB2.0协议,UTMI接口协议以及其它系统总线协议,这些协议增加EHCI控制器复杂度,从而使EHCI RTL完整的功能验证充满挑战。传统的EHCI控制器功能验证都是采用简单的直接测试,只专注一部分功能点进行验证,然后再通过FPGA测试得以保证。然而这两种测试方法不仅效率很低,而且不能覆盖EHCI控制器的所有功能,而没有被覆盖的功能往往会在应用产品中暴露出功能缺陷,从而严重影响产品的品质和信誉。为了保证产品功能的可靠性和完整性,提高公司产品质量,对EHCI控制器做完整的功能验证非常必要。针对以上问题,本课题基于UVM验证架构研究制定EHCI RTL级功能验证方案,编写完整的功能测试点,开发EHCI控制器的验证环境,并对EHCI主机控制器的功能进行严格的分析验证,最后进行大量仿真保证其功能覆盖率达到百分之百实现IP验证的完整性。从理论分析到具体实践为,经过反复测试,该课题取得很大成果。采用UVM架构对EHCI控制器做完整的功能验证,在较短时间内共找到一百个多EHCI控制器功能缺陷,功能覆盖率达到百分之百,代码覆盖率也符合预期。经过前期完整的功能验证,后期FPGA测试进展顺利,同时验证环境中的相关模块如主机驱动模块,设备驱动模块以及各个VIP模块在之后的OHCI控制器,OTG控制器功能验证中得到复用,从而节省更多人力和时间,体现了UVM验证方法论的基本思想。
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